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Libre Silicon

• 26 min
• 2018-03-30
• 250
• hsank

Verilog Design Patttern

• 74 min
• 2018-04-01
• 164
• hsank

LibreSilicon

Decentralizing semiconductor manufacturing

• 60 min
• 2018-12-27
• 4057
• leviathan, hsank and Andreas Westerwick

Lücken in der technischen Selbstverteidigung

Open the Blackbox, Close the Bugdoor

• 48 min
• 2014-09-13
• 156
• hsank